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8.1 KiB
C++
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// Created by Luca on 8/29/2025.
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#ifndef SHAL_GPIO_REG_F072XB_H
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#define SHAL_GPIO_REG_F072XB_H
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#include <stm32l432xx.h>
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#include <cassert>
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#include "SHAL_GPIO_TYPES.h"
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#define AVAILABLE_PORTS 2
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#define PINS_PER_PORT 16
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#define NUM_EXTI_LINES 16
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//Build enum map of available SHAL_GPIO pins
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enum class GPIO_Key : uint8_t {
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A0 = 0,
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A1 = 1,
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A2 = 2,
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A3 = 3,
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A4 = 4,
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A5 = 5,
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A6 = 6,
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A7 = 7,
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A8 = 8,
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A9,
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A10,
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A11,
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A12,
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A13,
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A14,
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A15,
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B0,
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B1,
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B3 = 19, //Offset to compensate for lack of B2
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B4,
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B5,
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B6,
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B7,
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NUM_GPIO,
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INVALID
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};
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enum class GPIO_Alternate_Function_Mapping {
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A0_TIM2CH1 = 0x01,
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A1_TIM2CH2 = 0x01,
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A2_TIM2CH3 = 0x01,
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|
A3_TIM2CH4 = 0x01,
|
|
A5_TIM2CH1 = 0x01,
|
|
A6_TIM1BKIN = 0x01,
|
|
A7_TIM1CH1N = 0x01,
|
|
A8_TIM1CH1 = 0x01,
|
|
A9_TIM1CH2 = 0x01,
|
|
A10_TIM1CH3 = 0x01,
|
|
A11_TIM1CH4 = 0x01,
|
|
A12_TIM1ETR = 0x01,
|
|
A15_TIM2CH1 = 0x01,
|
|
B0_TIM1CH2N = 0x01,
|
|
B1_TIM1CH3N = 0x01,
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|
};
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static volatile GPIO_TypeDef * GPIO_TABLE[2] = { //Lookup table for ADCs
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GPIOA,
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GPIOB
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};
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constexpr uint8_t getGPIOPinNumber(GPIO_Key key){
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return static_cast<uint8_t>(key) % 16;
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}
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constexpr uint8_t getGPIOPortNUmber(GPIO_Key key){
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return static_cast<uint8_t>(key) / 16;
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}
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constexpr SHAL_GPIO_EXTI_Register getGPIOEXTICR(const GPIO_Key g){
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switch(g) {
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case GPIO_Key::A0: return {&SYSCFG->EXTICR[0],SYSCFG_EXTICR1_EXTI0_PA,EXTI0_IRQn};
|
|
case GPIO_Key::A1: return {&SYSCFG->EXTICR[0],SYSCFG_EXTICR1_EXTI1_PA,EXTI1_IRQn};
|
|
case GPIO_Key::A2: return {&SYSCFG->EXTICR[0],SYSCFG_EXTICR1_EXTI2_PA,EXTI2_IRQn};
|
|
case GPIO_Key::A3: return {&SYSCFG->EXTICR[0],SYSCFG_EXTICR1_EXTI3_PA,EXTI3_IRQn};
|
|
case GPIO_Key::A4: return {&SYSCFG->EXTICR[1],SYSCFG_EXTICR2_EXTI4_PA,EXTI4_IRQn};
|
|
case GPIO_Key::A5: return {&SYSCFG->EXTICR[1],SYSCFG_EXTICR2_EXTI5_PA,EXTI9_5_IRQn};
|
|
case GPIO_Key::A6: return {&SYSCFG->EXTICR[1],SYSCFG_EXTICR2_EXTI6_PA,EXTI9_5_IRQn};
|
|
case GPIO_Key::A7: return {&SYSCFG->EXTICR[1],SYSCFG_EXTICR2_EXTI7_PA,EXTI9_5_IRQn};
|
|
case GPIO_Key::A8: return {&SYSCFG->EXTICR[2],SYSCFG_EXTICR3_EXTI8_PA,EXTI9_5_IRQn};
|
|
case GPIO_Key::A9: return {&SYSCFG->EXTICR[2],SYSCFG_EXTICR3_EXTI9_PA,EXTI9_5_IRQn};
|
|
case GPIO_Key::A10: return {&SYSCFG->EXTICR[2],SYSCFG_EXTICR3_EXTI10_PA,EXTI15_10_IRQn};
|
|
case GPIO_Key::A11: return {&SYSCFG->EXTICR[2],SYSCFG_EXTICR3_EXTI11_PA,EXTI15_10_IRQn};
|
|
case GPIO_Key::A12: return {&SYSCFG->EXTICR[3],SYSCFG_EXTICR4_EXTI12_PA,EXTI15_10_IRQn};
|
|
case GPIO_Key::A13: return {&SYSCFG->EXTICR[3],SYSCFG_EXTICR4_EXTI13_PA,EXTI15_10_IRQn};
|
|
case GPIO_Key::A14: return {&SYSCFG->EXTICR[3],SYSCFG_EXTICR4_EXTI14_PA,EXTI15_10_IRQn};
|
|
case GPIO_Key::A15: return {&SYSCFG->EXTICR[3],SYSCFG_EXTICR4_EXTI15_PA,EXTI15_10_IRQn};
|
|
case GPIO_Key::B0: return {&SYSCFG->EXTICR[0],SYSCFG_EXTICR1_EXTI0_PB,EXTI0_IRQn};
|
|
case GPIO_Key::B1: return {&SYSCFG->EXTICR[0],SYSCFG_EXTICR1_EXTI1_PB,EXTI1_IRQn};
|
|
case GPIO_Key::B3: return {&SYSCFG->EXTICR[0],SYSCFG_EXTICR1_EXTI3_PB,EXTI3_IRQn};
|
|
case GPIO_Key::B4: return {&SYSCFG->EXTICR[1],SYSCFG_EXTICR2_EXTI4_PB,EXTI4_IRQn};
|
|
case GPIO_Key::B5: return {&SYSCFG->EXTICR[1],SYSCFG_EXTICR2_EXTI5_PB,EXTI9_5_IRQn};
|
|
case GPIO_Key::B6: return {&SYSCFG->EXTICR[1],SYSCFG_EXTICR2_EXTI6_PB,EXTI9_5_IRQn};
|
|
case GPIO_Key::B7: return {&SYSCFG->EXTICR[1],SYSCFG_EXTICR2_EXTI7_PB,EXTI9_5_IRQn};
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case GPIO_Key::INVALID:
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case GPIO_Key::NUM_GPIO:
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assert(false);
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return SHAL_GPIO_EXTI_Register(nullptr, 0, static_cast<IRQn_Type>(0)); //Unreachable
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}
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__builtin_unreachable();
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}
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static inline SHAL_GPIO_RCC_Enable_Register getGPIORCCEnable(const GPIO_Key g){
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volatile uint32_t* reg = &RCC->AHB2ENR; //register
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uint32_t offset;
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offset = (static_cast<uint8_t>(g) / 16) == 0 ? RCC_AHB2ENR_GPIOAEN_Pos : RCC_AHB2ENR_GPIOBEN_Pos;
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return {reg,offset};
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|
}
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constexpr uint32_t getGPIOPortNumber(const GPIO_Key g){
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return (static_cast<uint8_t>(g) / 16);
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}
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static inline SHAL_GPIO_Mode_Register getGPIOModeRegister(const GPIO_Key key){
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|
volatile uint32_t* reg = &GPIO_TABLE[static_cast<uint8_t>(key) / 16]->MODER;
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|
uint32_t offset = 2 * (static_cast<uint8_t>(key) % 16);
|
|
return {reg,offset};
|
|
}
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static inline SHAL_GPIO_Pullup_Pulldown_Register getGPIOPUPDRegister(const GPIO_Key key){
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|
volatile uint32_t* reg = &GPIO_TABLE[static_cast<uint8_t>(key) / 16]->PUPDR;
|
|
uint32_t offset = 2 * static_cast<uint8_t>(key) % 16;
|
|
return {reg,offset};
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|
}
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static inline SHAL_GPIO_Alternate_Function_Register getGPIOAlternateFunctionRegister(const GPIO_Key key){
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uint32_t pinNumber = static_cast<uint8_t>(key) % 16; //Number of pin (We need 0-7 to be AFR 1 and 8-15 to be AFR 2)
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uint32_t afrIndex = pinNumber < 8 ? 0 : 1;
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volatile uint32_t* reg = &GPIO_TABLE[static_cast<uint8_t>(key) / 16]->AFR[afrIndex];
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uint32_t offset = (pinNumber % 8) * 4; //Increment in groups of four
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|
return {reg,offset};
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|
}
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static inline SHAL_GPIO_Output_Speed_Register getGPIOOutputSpeedRegister(const GPIO_Key key){
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|
volatile uint32_t* reg = &GPIO_TABLE[static_cast<uint8_t>(key) / 16]->OSPEEDR;
|
|
uint32_t offset = 2 * static_cast<uint8_t>(key) % 16;
|
|
return {reg,offset};
|
|
}
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|
|
static inline SHAL_GPIO_Output_Type_Register getGPIOOutputTypeRegister(const GPIO_Key key){
|
|
volatile uint32_t* reg = &GPIO_TABLE[static_cast<uint8_t>(key) / 16]->OTYPER;
|
|
uint32_t offset = static_cast<uint8_t>(key) % 16;
|
|
return {reg,offset};
|
|
}
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|
static inline SHAL_GPIO_Output_Data_Register getGPIOOutputDataRegister(const GPIO_Key key){
|
|
volatile uint32_t* reg = &GPIO_TABLE[static_cast<uint8_t>(key) / 16]->ODR;
|
|
uint32_t offset = (static_cast<uint8_t>(key) % 16);
|
|
return {reg,offset};
|
|
}
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static inline SHAL_GPIO_Input_Data_Register getGPIOInputDataRegister(const GPIO_Key key){
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|
volatile uint32_t* reg = &GPIO_TABLE[static_cast<uint8_t>(key) / 16]->IDR;
|
|
uint32_t offset = static_cast<uint8_t>(key) % 16;
|
|
return {reg,offset};
|
|
}
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constexpr SHAL_GPIO_Port_Info getGPIOPortInfo(GPIO_Key key){
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switch(key){
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case GPIO_Key::A0:
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return {0, SHAL_ADC_Channel::CH5};
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case GPIO_Key::B0:
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return {0, SHAL_ADC_Channel::CH15};
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case GPIO_Key::A1:
|
|
return {1, SHAL_ADC_Channel::CH6};
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|
case GPIO_Key::B1:
|
|
return {1, SHAL_ADC_Channel::CH16};
|
|
case GPIO_Key::A2:
|
|
return {2, SHAL_ADC_Channel::CH7};
|
|
case GPIO_Key::A3:
|
|
return {3, SHAL_ADC_Channel::CH8};
|
|
case GPIO_Key::B3:
|
|
return {3, SHAL_ADC_Channel::NO_ADC_MAPPING};
|
|
case GPIO_Key::A4:
|
|
return {4, SHAL_ADC_Channel::CH9};
|
|
case GPIO_Key::B4:
|
|
return {4, SHAL_ADC_Channel::NO_ADC_MAPPING};
|
|
case GPIO_Key::A5:
|
|
return {5, SHAL_ADC_Channel::CH10};
|
|
case GPIO_Key::B5:
|
|
return {5, SHAL_ADC_Channel::NO_ADC_MAPPING};
|
|
case GPIO_Key::A6:
|
|
return {6, SHAL_ADC_Channel::CH11};
|
|
case GPIO_Key::B6:
|
|
return {6, SHAL_ADC_Channel::NO_ADC_MAPPING};
|
|
case GPIO_Key::A7:
|
|
return {7, SHAL_ADC_Channel::CH12};
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|
case GPIO_Key::B7:
|
|
return {7, SHAL_ADC_Channel::NO_ADC_MAPPING};
|
|
case GPIO_Key::A8:
|
|
return {8, SHAL_ADC_Channel::NO_ADC_MAPPING};
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|
case GPIO_Key::A9:
|
|
return {9, SHAL_ADC_Channel::NO_ADC_MAPPING};
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|
case GPIO_Key::A10:
|
|
return {10, SHAL_ADC_Channel::NO_ADC_MAPPING};
|
|
case GPIO_Key::A11:
|
|
return {11, SHAL_ADC_Channel::NO_ADC_MAPPING};
|
|
case GPIO_Key::A12:
|
|
return {12, SHAL_ADC_Channel::NO_ADC_MAPPING};
|
|
case GPIO_Key::A13:
|
|
return {13, SHAL_ADC_Channel::NO_ADC_MAPPING};
|
|
case GPIO_Key::A14:
|
|
return {14, SHAL_ADC_Channel::NO_ADC_MAPPING};
|
|
case GPIO_Key::A15:
|
|
return {15, SHAL_ADC_Channel::NO_ADC_MAPPING};
|
|
case GPIO_Key::NUM_GPIO:
|
|
case GPIO_Key::INVALID:
|
|
return {0, SHAL_ADC_Channel::NO_ADC_MAPPING};
|
|
}
|
|
__builtin_unreachable();
|
|
}
|
|
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#endif //SHAL_GPIO_REG_F072XB_H
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